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       2              :  * Copyright (c) 2025 Renesas Electronics Corporation
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       4              :  * SPDX-License-Identifier: Apache-2.0
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      10            0 : #define RZA2M_MODULE_CORESIGHT 1UL
      11            0 : #define RZA2M_MODULE_OSTM0     2UL
      12            0 : #define RZA2M_MODULE_OSTM1     3UL
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      53            0 : #define RZA2M_MODULE_DRP       44UL
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      58              : 
      59              : /** RZ/A2M clock configuration values */
      60            1 : #define RZA2M_MODULE_SHIFT    8UL
      61            0 : #define RZA2M_CLOCK_SRC_SHIFT 0UL
      62              : 
      63            0 : #define RZA2M_CLK_EXTAL 0UL
      64            0 : #define RZA2M_CLK_I     1UL
      65            0 : #define RZA2M_CLK_G     2UL
      66            0 : #define RZA2M_CLK_B     3UL
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      69            0 : #define RZA2M_CLK_P0    5UL
      70              : 
      71            0 : #define RZA2M_CLOCK(module, clk)                                                                   \
      72              :         (((module) << RZA2M_MODULE_SHIFT) | ((clk) << RZA2M_CLOCK_SRC_SHIFT))
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      74              : /*
      75              :  * Example: RZA2M_CLOCK(MODULE_SCIFA4, RZA2M_CLK_P1C) // SCIFA4
      76              :  */
      77              : 
      78              : #endif /* ZEPHYR_INCLUDE_DT_BINDINGS_CLOCK_RENESAS_RZA2M_CLOCK_H_ */