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       4              :  * Copyright (c) 2025 Nordic Semiconductor ASA
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       7              : #ifndef ZEPHYR_INCLUDE_DT_BINDINGS_ADC_NRF_COMP_H_
       8              : #define ZEPHYR_INCLUDE_DT_BINDINGS_ADC_NRF_COMP_H_
       9              : 
      10            0 : #define NRF_COMP_AIN0 0 /** AIN0 external input */
      11            0 : #define NRF_COMP_AIN1 1 /** AIN1 external input */
      12            0 : #define NRF_COMP_AIN2 2 /** AIN2 external input */
      13            0 : #define NRF_COMP_AIN3 3 /** AIN3 external input */
      14            0 : #define NRF_COMP_AIN4 4 /** AIN4 external input */
      15            0 : #define NRF_COMP_AIN5 5 /** AIN5 external input */
      16            0 : #define NRF_COMP_AIN6 6 /** AIN6 external input */
      17            0 : #define NRF_COMP_AIN7 7 /** AIN7 external input */
      18            0 : #define NRF_COMP_AIN_VDD_DIV2 8 /** VDD / 2 */
      19            0 : #define NRF_COMP_AIN_VDDH_DIV5 9 /** VDDH / 5 */
      20              : 
      21              : #endif /* ZEPHYR_INCLUDE_DT_BINDINGS_ADC_NRF_COMP_H_ */