LCOV - code coverage report
Current view: top level - zephyr/dt-bindings/power - imx_scu_rsrc.h Hit Total Coverage
Test: new.info Lines: 0 548 0.0 %
Date: 2024-12-22 00:14:23

          Line data    Source code
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       2             :  * Copyright 2024 NXP
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     155           0 : #define IMX_SC_R_GPU_0_PID1           145U
     156           0 : #define IMX_SC_R_GPU_0_PID2           146U
     157           0 : #define IMX_SC_R_GPU_0_PID3           147U
     158           0 : #define IMX_SC_R_GPU_1_PID0           148U
     159           0 : #define IMX_SC_R_GPU_1_PID1           149U
     160           0 : #define IMX_SC_R_GPU_1_PID2           150U
     161           0 : #define IMX_SC_R_GPU_1_PID3           151U
     162           0 : #define IMX_SC_R_PCIE_A               152U
     163           0 : #define IMX_SC_R_SERDES_0             153U
     164           0 : #define IMX_SC_R_MATCH_0              154U
     165           0 : #define IMX_SC_R_MATCH_1              155U
     166           0 : #define IMX_SC_R_MATCH_2              156U
     167           0 : #define IMX_SC_R_MATCH_3              157U
     168           0 : #define IMX_SC_R_MATCH_4              158U
     169           0 : #define IMX_SC_R_MATCH_5              159U
     170           0 : #define IMX_SC_R_MATCH_6              160U
     171           0 : #define IMX_SC_R_MATCH_7              161U
     172           0 : #define IMX_SC_R_MATCH_8              162U
     173           0 : #define IMX_SC_R_MATCH_9              163U
     174           0 : #define IMX_SC_R_MATCH_10             164U
     175           0 : #define IMX_SC_R_MATCH_11             165U
     176           0 : #define IMX_SC_R_MATCH_12             166U
     177           0 : #define IMX_SC_R_MATCH_13             167U
     178           0 : #define IMX_SC_R_MATCH_14             168U
     179           0 : #define IMX_SC_R_PCIE_B               169U
     180           0 : #define IMX_SC_R_SATA_0               170U
     181           0 : #define IMX_SC_R_SERDES_1             171U
     182           0 : #define IMX_SC_R_HSIO_GPIO            172U
     183           0 : #define IMX_SC_R_MATCH_15             173U
     184           0 : #define IMX_SC_R_MATCH_16             174U
     185           0 : #define IMX_SC_R_MATCH_17             175U
     186           0 : #define IMX_SC_R_MATCH_18             176U
     187           0 : #define IMX_SC_R_MATCH_19             177U
     188           0 : #define IMX_SC_R_MATCH_20             178U
     189           0 : #define IMX_SC_R_MATCH_21             179U
     190           0 : #define IMX_SC_R_MATCH_22             180U
     191           0 : #define IMX_SC_R_MATCH_23             181U
     192           0 : #define IMX_SC_R_MATCH_24             182U
     193           0 : #define IMX_SC_R_MATCH_25             183U
     194           0 : #define IMX_SC_R_MATCH_26             184U
     195           0 : #define IMX_SC_R_MATCH_27             185U
     196           0 : #define IMX_SC_R_MATCH_28             186U
     197           0 : #define IMX_SC_R_LCD_0                187U
     198           0 : #define IMX_SC_R_LCD_0_PWM_0          188U
     199           0 : #define IMX_SC_R_LCD_0_I2C_0          189U
     200           0 : #define IMX_SC_R_LCD_0_I2C_1          190U
     201           0 : #define IMX_SC_R_PWM_0                191U
     202           0 : #define IMX_SC_R_PWM_1                192U
     203           0 : #define IMX_SC_R_PWM_2                193U
     204           0 : #define IMX_SC_R_PWM_3                194U
     205           0 : #define IMX_SC_R_PWM_4                195U
     206           0 : #define IMX_SC_R_PWM_5                196U
     207           0 : #define IMX_SC_R_PWM_6                197U
     208           0 : #define IMX_SC_R_PWM_7                198U
     209           0 : #define IMX_SC_R_GPIO_0               199U
     210           0 : #define IMX_SC_R_GPIO_1               200U
     211           0 : #define IMX_SC_R_GPIO_2               201U
     212           0 : #define IMX_SC_R_GPIO_3               202U
     213           0 : #define IMX_SC_R_GPIO_4               203U
     214           0 : #define IMX_SC_R_GPIO_5               204U
     215           0 : #define IMX_SC_R_GPIO_6               205U
     216           0 : #define IMX_SC_R_GPIO_7               206U
     217           0 : #define IMX_SC_R_GPT_0                207U
     218           0 : #define IMX_SC_R_GPT_1                208U
     219           0 : #define IMX_SC_R_GPT_2                209U
     220           0 : #define IMX_SC_R_GPT_3                210U
     221           0 : #define IMX_SC_R_GPT_4                211U
     222           0 : #define IMX_SC_R_KPP                  212U
     223           0 : #define IMX_SC_R_MU_0A                213U
     224           0 : #define IMX_SC_R_MU_1A                214U
     225           0 : #define IMX_SC_R_MU_2A                215U
     226           0 : #define IMX_SC_R_MU_3A                216U
     227           0 : #define IMX_SC_R_MU_4A                217U
     228           0 : #define IMX_SC_R_MU_5A                218U
     229           0 : #define IMX_SC_R_MU_6A                219U
     230           0 : #define IMX_SC_R_MU_7A                220U
     231           0 : #define IMX_SC_R_MU_8A                221U
     232           0 : #define IMX_SC_R_MU_9A                222U
     233           0 : #define IMX_SC_R_MU_10A               223U
     234           0 : #define IMX_SC_R_MU_11A               224U
     235           0 : #define IMX_SC_R_MU_12A               225U
     236           0 : #define IMX_SC_R_MU_13A               226U
     237           0 : #define IMX_SC_R_MU_5B                227U
     238           0 : #define IMX_SC_R_MU_6B                228U
     239           0 : #define IMX_SC_R_MU_7B                229U
     240           0 : #define IMX_SC_R_MU_8B                230U
     241           0 : #define IMX_SC_R_MU_9B                231U
     242           0 : #define IMX_SC_R_MU_10B               232U
     243           0 : #define IMX_SC_R_MU_11B               233U
     244           0 : #define IMX_SC_R_MU_12B               234U
     245           0 : #define IMX_SC_R_MU_13B               235U
     246           0 : #define IMX_SC_R_ROM_0                236U
     247           0 : #define IMX_SC_R_FSPI_0               237U
     248           0 : #define IMX_SC_R_FSPI_1               238U
     249           0 : #define IMX_SC_R_IEE                  239U
     250           0 : #define IMX_SC_R_IEE_R0               240U
     251           0 : #define IMX_SC_R_IEE_R1               241U
     252           0 : #define IMX_SC_R_IEE_R2               242U
     253           0 : #define IMX_SC_R_IEE_R3               243U
     254           0 : #define IMX_SC_R_IEE_R4               244U
     255           0 : #define IMX_SC_R_IEE_R5               245U
     256           0 : #define IMX_SC_R_IEE_R6               246U
     257           0 : #define IMX_SC_R_IEE_R7               247U
     258           0 : #define IMX_SC_R_SDHC_0               248U
     259           0 : #define IMX_SC_R_SDHC_1               249U
     260           0 : #define IMX_SC_R_SDHC_2               250U
     261           0 : #define IMX_SC_R_ENET_0               251U
     262           0 : #define IMX_SC_R_ENET_1               252U
     263           0 : #define IMX_SC_R_MLB_0                253U
     264           0 : #define IMX_SC_R_DMA_2_CH0            254U
     265           0 : #define IMX_SC_R_DMA_2_CH1            255U
     266           0 : #define IMX_SC_R_DMA_2_CH2            256U
     267           0 : #define IMX_SC_R_DMA_2_CH3            257U
     268           0 : #define IMX_SC_R_DMA_2_CH4            258U
     269           0 : #define IMX_SC_R_USB_0                259U
     270           0 : #define IMX_SC_R_USB_1                260U
     271           0 : #define IMX_SC_R_USB_0_PHY            261U
     272           0 : #define IMX_SC_R_USB_2                262U
     273           0 : #define IMX_SC_R_USB_2_PHY            263U
     274           0 : #define IMX_SC_R_DTCP                 264U
     275           0 : #define IMX_SC_R_NAND                 265U
     276           0 : #define IMX_SC_R_LVDS_0               266U
     277           0 : #define IMX_SC_R_LVDS_0_PWM_0         267U
     278           0 : #define IMX_SC_R_LVDS_0_I2C_0         268U
     279           0 : #define IMX_SC_R_LVDS_0_I2C_1         269U
     280           0 : #define IMX_SC_R_LVDS_1               270U
     281           0 : #define IMX_SC_R_LVDS_1_PWM_0         271U
     282           0 : #define IMX_SC_R_LVDS_1_I2C_0         272U
     283           0 : #define IMX_SC_R_LVDS_1_I2C_1         273U
     284           0 : #define IMX_SC_R_LVDS_2               274U
     285           0 : #define IMX_SC_R_LVDS_2_PWM_0         275U
     286           0 : #define IMX_SC_R_LVDS_2_I2C_0         276U
     287           0 : #define IMX_SC_R_LVDS_2_I2C_1         277U
     288           0 : #define IMX_SC_R_M4_0_PID0            278U
     289           0 : #define IMX_SC_R_M4_0_PID1            279U
     290           0 : #define IMX_SC_R_M4_0_PID2            280U
     291           0 : #define IMX_SC_R_M4_0_PID3            281U
     292           0 : #define IMX_SC_R_M4_0_PID4            282U
     293           0 : #define IMX_SC_R_M4_0_RGPIO           283U
     294           0 : #define IMX_SC_R_M4_0_SEMA42          284U
     295           0 : #define IMX_SC_R_M4_0_TPM             285U
     296           0 : #define IMX_SC_R_M4_0_PIT             286U
     297           0 : #define IMX_SC_R_M4_0_UART            287U
     298           0 : #define IMX_SC_R_M4_0_I2C             288U
     299           0 : #define IMX_SC_R_M4_0_INTMUX          289U
     300           0 : #define IMX_SC_R_ENET_0_A0            290U
     301           0 : #define IMX_SC_R_ENET_0_A1            291U
     302           0 : #define IMX_SC_R_M4_0_MU_0B           292U
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     304           0 : #define IMX_SC_R_M4_0_MU_0A1          294U
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     311           0 : #define IMX_SC_R_M4_1_PID3            301U
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     324           0 : #define IMX_SC_R_M4_1_MU_0A1          314U
     325           0 : #define IMX_SC_R_M4_1_MU_0A2          315U
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     327           0 : #define IMX_SC_R_M4_1_MU_1A           317U
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     343           0 : #define IMX_SC_R_PI_1_PWM_1           333U
     344           0 : #define IMX_SC_R_PI_1_I2C_0           334U
     345           0 : #define IMX_SC_R_PI_1_PLL             335U
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     430           0 : #define IMX_SC_R_SAI_5                420U
     431           0 : #define IMX_SC_R_GPT_5                421U
     432           0 : #define IMX_SC_R_GPT_6                422U
     433           0 : #define IMX_SC_R_GPT_7                423U
     434           0 : #define IMX_SC_R_GPT_8                424U
     435           0 : #define IMX_SC_R_GPT_9                425U
     436           0 : #define IMX_SC_R_GPT_10               426U
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     463           0 : #define IMX_SC_R_DMA_2_CH31           453U
     464           0 : #define IMX_SC_R_ASRC_1               454U
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     558             : #endif /* ZEPHYR_INCLUDE_DT_BINDINGS_POWER_IMX_SCU_RSRC_H_ */

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